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基于FPGA的数字相敏检波算法实现
数字相敏检波（DPSD） FPGAADCDSP测试 系统高速 采样系统
2014/4/2
数字相敏检波（DPSD）算法是一种有效的信号检测方法。针对某些高速采样系统采用现有DSP芯片控制模数转换和进行DPSD算法运算所出现的控制精度不高和运算速度慢等问题，详细分析了DPSD算法，设计了基于FPGA的数字相敏检波算法。该算法解决了控制信号精度不高等问题，满足高速采样系统对运算速度的要求。试验结果表明，基于FPGA的数字相敏检测算法在测试系统中能有较好的检测效果。